伪码连续波交会对接雷达信号处理机设计（完整版）实用资料(可以直接使用，可编辑完整版实用资料，欢迎下载）信号与数据处理伪码连续波交会对接雷达信号处理机设计*耿生群,吴嗣亮(北京理工大学信息科学技术学院,北京100081摘要介绍了某伪码连续波交会对接雷达信号处理机设计。在测距中,提出用噪声较小的载波相位伪距测量值对伪距进行处理,得到高精度测距值。在测角中,提出了一种干涉仪天线阵结构和干涉仪解模糊算法,针对通道载波相位误差可能引起的解模糊错误,又提出了一种纠正方法,仿真显示,在发生解模糊错误的概率高达0.42的情况下,该方法仍然可以识别并纠正所有解模糊错误。实验表明,该信号处理机可以满足空间航天器交会对接的要求。关键词伪码;交会对接雷达;干涉仪中图分类号:TN957文献标识码:APseudocodeCWRVDRadarSignalProcessorDesignGENGShengqun,WUSiliang(SchoolofInformationScienceandTechnology,BIT,Beijing100081,ChinaAbstractInthispaper,adesignofpseudocodeCWRendezvousandDocking(RVDradarsignalprocessorispresented.Inrangingprocedure,thepseudorangeisprocessedwithdeltapseudorangefromthecarrierloopwithsmallnoise,andtheprecisionisimproved.Inanglemeasuring,anantennaconfigurationandinterferometerambiguityresolvingalgorithmareproposed,andtoeliminatetheerrorcausedbycarrierphaseerror,acorrectionmethodisintroduced,throughwhichallambiguityresolvingerrorcanberecognizedandbecorrectedevenwhentheerrorprobabilityisupto0.42.TestsindicatethatthesignalprocessorcanmeettherequirementsofRendezvousandDocking.Keywordspseudocode;rendezvousanddockingradar;interferometer0引言在某交会对接雷达系统中,系统由雷达和应答机组成,雷达发射由伪随机码调制的扩谱信号,应答机对扩谱信号进行相干转发。雷达通过捕获跟踪相干转发信号的伪码和载波相位,实现对目标距离和方位测量,它具有低截获概率、抗干扰等优点[1]。1雷达信号处理机的组成雷达信号处理机包括发射和接收两个模块,发射模块产生发射伪码和系统同步时钟;接收模块以同步时钟为参考,产生再生伪码和载波,通过跟踪算法控制本地再生载波和伪码与接收信号完全相同。图1为雷达信号处理机的结构框图。信号处理机采用软件化设计,由DSP和FPGA实现。信号处理机由主信号处理器、通信信号处理器、FFT快捕FPGA、主通道FPGA和干涉测角FPGA等组成。进入信号处理机的信号包括一路主接收通道数字中频信号和8路干图1雷达信号处理机结构框图涉测角通道数字中频信号。主信号处理器为TI公司的TMS320C6701,主要功能为:在FFT快捕FPGA发出捕获中断时,读取快捕结果,将快捕结果快速置入主通道FPGA的码环和载波环中;定时读取主通道FPGA和干涉测角FPGA的积发累加结果,通过环路跟踪算法控制环路闭合。当主通道FPGA的载波环和码环以及干涉测角FPGA的37第28卷第9期2006年9月现代雷达ModernRadarVo.l28No.9September2006::8个载波环均进入锁定状态后,从码环和载波环中分别读取码相位和载波相位,通过数据处理,得到目标的距离和方位信息。通信信号处理器为TMS320VC5509,它通过数据重新组帧,改变数据率,实现外部设备和主通道FPGA之间的通信,并通过I/O接口采集3片FPGA的工作状态,向主信号处理器报告。FFT快捕FPGA采用Xilinx公司的XC2V3000,它通过FFT和IFFT运算,快速捕获相干转发信号的载波多普勒频率和伪码相位[2]。主通道FPGA和干涉测角FPGA均采用XC2V1000,主通道FPGA产生系统同步时钟和发射伪码,并产生再生载波和再生伪码,对主通道数字中频信号进行下变频、解