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实验译码器优先编码器3-8译码器和8-3优先编码器实验内容设计一个3-8译码器及其仿真代码设计一个8-3优先编码器及其仿真代码用modelsim进行仿真用quartusII进行综合(使用的FPGA器件为CycloneIIEP2C70F896C6)实验报告要求给出实验步骤给出设计源代码和仿真源代码给出时序仿真结果(要有波形图)给出综合结果(要有综合的结果)给出仿真结果、实验结果分析和结论译码器例子:RTL代码和测试代码仿真结果示例